net/af_xdp: fix redundant check for wakeup need
[dpdk.git] / examples / ip_pipeline / examples / rss.cli
1 ; SPDX-License-Identifier: BSD-3-Clause
2 ; Copyright(c) 2010-2018 Intel Corporation
3
4 ; This setup demonstrates the usage of NIC Receive Side Scaling (RSS) feature.
5 ; Each NIC splits the input traffic into 4 RX queues, with each of its RX queues
6 ; being handled by a different pipeline:
7 ;
8 ;                                                    +-----------+    +----------+
9 ;                       +--------------------------->|           |    |          |
10 ;                       |       +------------------->| PIPELINE0 +--->|  LINK 0  |--->
11 ;                       |       |     +------------->| (CORE A)  |    |    TX    |
12 ;                       |       |     |     +------->|           |    |          |
13 ;                       |       |     |     |        +-----------+    +----------+
14 ;    +----------+       |       |     |     |
15 ;    |          |-------+       |     |     |
16 ;--->|  LINK 0  |-----------+   |     |     |
17 ;    |    RX    |---------+ |   |     |     |
18 ;    |          |-------+ | |   |     |     |
19 ;    +----------+       | | |   |     |     |        +-----------+    +----------+
20 ;                       | | +---|-----|-----|------->|           |    |          |
21 ;    +----------+       | |     | +---|-----|------->| PIPELINE1 +--->|  LINK 1  |--->
22 ;    |          |-------|-|-----+ |   | +---|------->| (CORE B)  |    |    TX    |
23 ;--->|  LINK 1  |-------|-|-------+   | |   | +----->|           |    |          |
24 ;    |    RX    |-------|-|-------+   | |   | |      +-----------+    +----------+
25 ;    |          |-------|-|-----+ |   | |   | |
26 ;    +----------+       | |     | |   | |   | |
27 ;                       | |     | |   | |   | |
28 ;    +----------+       | |     | |   | |   | |
29 ;    |          |-------|-|-----|-|---+ |   | |
30 ;--->|  LINK 2  |-------|-|-----|-|-----+   | |      +-----------+    +----------+
31 ;    |    RX    |-----+ | +-----|-|---------|-|----->|           |    |          |
32 ;    |          |---+ | |       | +---------|-|----->| PIPELINE2 +--->|  LINK 2  |--->
33 ;    +----------+   | +-|-------|-----------|-|----->| (CORE C)  |    |    TX    |
34 ;                   |   |       |           | | +--->|           |    |          |
35 ;    +----------+   |   |       |           | | |    +-----------+    +----------+
36 ;    |          |---|---|-------|-----------+ | |
37 ;--->|  LINK 3  |---|---|-------|-------------+ |
38 ;    |    RX    |---|---|-------|---------------+
39 ;    |          |---|---|-------|-----------+
40 ;    +----------+   |   |       |           |
41 ;                   |   |       |           |        +-----------+    +----------+
42 ;                   |   +-------|-----------|------->|           |    |          |
43 ;                   |           +-----------|------->| PIPELINE3 +--->|  LINK 3  |--->
44 ;                   +-----------------------|------->| (CORE D)  |    |    TX    |
45 ;                                           +------->|           |    |          |
46 ;                                                    +-----------+    +----------+
47 ;
48 ;
49
50 mempool MEMPOOL0 buffer 2304 pool 32K cache 256 cpu 0
51
52 link LINK0 dev 0000:02:00.0 rxq 4 128 MEMPOOL0 txq 1 512 promiscuous on rss 0 1 2 3
53 link LINK1 dev 0000:02:00.1 rxq 4 128 MEMPOOL0 txq 1 512 promiscuous on rss 0 1 2 3
54 link LINK2 dev 0000:06:00.0 rxq 4 128 MEMPOOL0 txq 1 512 promiscuous on rss 0 1 2 3
55 link LINK3 dev 0000:06:00.1 rxq 4 128 MEMPOOL0 txq 1 512 promiscuous on rss 0 1 2 3
56
57 pipeline PIPELINE0 period 10 offset_port_id 0 cpu 0
58 pipeline PIPELINE0 port in bsz 32 link LINK0 rxq 0
59 pipeline PIPELINE0 port in bsz 32 link LINK1 rxq 0
60 pipeline PIPELINE0 port in bsz 32 link LINK2 rxq 0
61 pipeline PIPELINE0 port in bsz 32 link LINK3 rxq 0
62 pipeline PIPELINE0 port out bsz 32 link LINK0 txq 0
63 pipeline PIPELINE0 table match stub
64 pipeline PIPELINE0 port in 0 table 0
65 pipeline PIPELINE0 port in 1 table 0
66 pipeline PIPELINE0 port in 2 table 0
67 pipeline PIPELINE0 port in 3 table 0
68 pipeline PIPELINE0 table 0 rule add match default action fwd port 0
69
70 pipeline PIPELINE1 period 10 offset_port_id 0 cpu 0
71 pipeline PIPELINE1 port in bsz 32 link LINK0 rxq 1
72 pipeline PIPELINE1 port in bsz 32 link LINK1 rxq 1
73 pipeline PIPELINE1 port in bsz 32 link LINK2 rxq 1
74 pipeline PIPELINE1 port in bsz 32 link LINK3 rxq 1
75 pipeline PIPELINE1 port out bsz 32 link LINK1 txq 0
76 pipeline PIPELINE1 table match stub
77 pipeline PIPELINE1 port in 0 table 0
78 pipeline PIPELINE1 port in 1 table 0
79 pipeline PIPELINE1 port in 2 table 0
80 pipeline PIPELINE1 port in 3 table 0
81 pipeline PIPELINE1 table 0 rule add match default action fwd port 0
82
83 pipeline PIPELINE2 period 10 offset_port_id 0 cpu 0
84 pipeline PIPELINE2 port in bsz 32 link LINK0 rxq 2
85 pipeline PIPELINE2 port in bsz 32 link LINK1 rxq 2
86 pipeline PIPELINE2 port in bsz 32 link LINK2 rxq 2
87 pipeline PIPELINE2 port in bsz 32 link LINK3 rxq 2
88 pipeline PIPELINE2 port out bsz 32 link LINK2 txq 0
89 pipeline PIPELINE2 table match stub
90 pipeline PIPELINE2 port in 0 table 0
91 pipeline PIPELINE2 port in 1 table 0
92 pipeline PIPELINE2 port in 2 table 0
93 pipeline PIPELINE2 port in 3 table 0
94 pipeline PIPELINE2 table 0 rule add match default action fwd port 0
95
96 pipeline PIPELINE3 period 10 offset_port_id 0 cpu 0
97 pipeline PIPELINE3 port in bsz 32 link LINK0 rxq 3
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108
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112 thread 4 pipeline PIPELINE3 enable